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1.問(wèn)答題 采用降維法用一片集成8選1數(shù)據(jù)選擇器CT74151和必要的門電路實(shí)現(xiàn)下列邏輯函數(shù)。

2.問(wèn)答題 分析題圖所示同步計(jì)數(shù)器電路。

3.判斷題原碼和補(bǔ)碼均可實(shí)現(xiàn)將減法運(yùn)算轉(zhuǎn)化為加法運(yùn)算。

4.問(wèn)答題 在題圖所示各電路中，要實(shí)現(xiàn)相應(yīng)表達(dá)式規(guī)定的邏輯功能，電路連接上有什么錯(cuò)誤？請(qǐng)改正之。
電路中所示均為CMOS門電路。

5 十進(jìn)制數(shù)12.75用二進(jìn)制表示應(yīng)為：（）。

6.問(wèn)答題 完成下列數(shù)的轉(zhuǎn)換。

7 當(dāng)晶體三極管（）時(shí)處于導(dǎo)通狀態(tài)。

8.問(wèn)答題用一片集成3線-8線譯碼器CT74138和必要的門電路設(shè)計(jì)一個(gè)運(yùn)算電路，當(dāng)K＝1時(shí)，實(shí)現(xiàn)一位全加器；當(dāng)K＝0時(shí)，實(shí)現(xiàn)一位全減器。

9 標(biāo)準(zhǔn)或-與式是由（）構(gòu)成的邏輯表達(dá)式。

數(shù)字電路與邏輯設(shè)計(jì)章節(jié)練習(xí)(2020.04.14)