單項(xiàng)選擇題

組合邏輯電路中的險(xiǎn)象是由于（）引起的。

A.電路未達(dá)到最簡(jiǎn)
B.電路有多個(gè)輸出
C.電路中的時(shí)延
D.邏輯門(mén)類(lèi)型不同

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